PCB Bolg - 電路板設計如何確保信號完整性

在電路板設計中，信號完整性（SI）問題解决得越早，設計的效率就越高，從而可避免在電路板設計完成之後才新增端接器件。 SI設計規劃的工具和資源不少，現在我們探索信號完整性的覈心議題以及解决SI問題的幾種方法。

1、SI問題的提出

隨著IC輸出開關速度的提高，不管訊號週期如何，幾乎所有設計都遇到了信號完整性問題。 即使過去你沒有遇到SI問題，但是隨著電路工作頻率的提高，今後一定會遇到信號完整性問題。

信號完整性問題主要指訊號的過沖和阻尼振盪現象，它們主要是IC驅動幅度和跳變時間的函數。 也就是說，即使佈線拓撲結構沒有變化，只要晶片速度變得足够快，現有設計也將處於臨界狀態或者停止工作。 我們用兩個實例來說明信號完整性設計是不可避免的。

實例之一∶在通信領域，前沿的電信公司正為語音和資料交換生產高速電路板（高於500MHz），此時成本並不特別重要，因而可以儘量採用多層板。 這樣的電路板可以實現充分接地並容易構成電源回路，也可以根據需要採用大量離散的端接器件，但是設計必須正確，不能處於臨界狀態。

SI和EMC專家在佈線之前要進行模擬和計算，然後，電路板設計就可以遵循一系列非常嚴格的設計規則，在有疑問的地方，可以新增端接器件，從而獲得盡可能多的SI安全裕量。 電路板實際工作過程中，總會出現一些問題，為此，通過採用可控阻抗端接線，可以避免出現SI問題。 簡而言之，超標準設計可以解决SI問題。

實例之二∶從成本上考慮，電路板通常限制在四層以內（裡面兩層分別是電源層和接地層）。 這極大限制了阻抗控制的作用。 此外，佈線層少將加劇串擾，同時訊號線間距還必須最小以布放更多的印製線。 另一方面，設計工程師必須採用最新和最好的CPU、記憶體和視頻匯流排設計，這些設計就必須考慮SI問題。

關於佈線、拓撲結構和端接管道，工程師通常可以從CPU製造商那裡獲得大量建議，然而，這些設計指南還有必要與製造過程結合起來。 在很大程度上，電路板設計師的工作比電信設計師的工作要困難，因為新增阻抗控制和端接器件的空間很小。 此時要充分研究並解决那些不完整的訊號，同時確保產品的設計期限。

電路板設計

下麵介紹電路板設計過程通用的SI設計準則。

2、電路板設計前的準備工作

在設計開始之前，必須先行思考並確定設計策略，這樣才能指導諸如元器件的選擇、工藝選擇和電路板生產成本控制等工作。 就SI而言，要預先進行調研以形成規劃或者設計準則，從而確保設計結果不出現明顯的SI問題、串擾或者時序問題。 有些設計準則可以由IC製造商提供，然而，晶片供應商提供的準則（或者你自己設計的準則）存在一定的局限性，按照這樣的準則可能根本設計不了滿足SI要求的電路板。 如果設計規則很容易，也就不需要設計工程師了。

在實際佈線之前，首先要解决下列問題，在多數情况下，這些問題會影響你正在設計（或者正在考慮設計）的電路板，如果電路板的數量很大，這項工作就是有價值的。

3、電路板的層疊

某些項目組對PCB層數的確定有很大的自主權，而另外一些項目組卻沒有這種自主權，囙此，瞭解你所處的位置很重要。 與製造和成本分析工程師交流可以確定電路板的層疊誤差，這時還是發現電路板製造公差的良機。 比如，如果你指定某一層是50Ω阻抗控制，製造商怎樣量測並確保這個數值呢？

其它的重要問題包括∶預期的製造公差是多少？ 在電路板上預期的絕緣常數是多少？ 線寬和間距的允許誤差是多少？ 接地層和訊號層的厚度和間距的允許誤差是多少？ 所有這些資訊可以在預佈線階段使用。

根據上述數據，你就可以選擇層疊了。 注意，幾乎每一個插入其它電路板或者背板的PCB都有厚度要求，而且多數電路板製造商對其可製造的不同類型的層有固定的厚度要求，這將會極大地約束最終層疊的數目。 你可能很想與製造商緊密合作來定義層疊的數目。 應該採用阻抗控制工具為不同層生成目標阻抗範圍，務必要考慮到製造商提供的製造允許誤差和鄰近佈線的影響。

在訊號完整的理想情况下，所有高速節點應該佈線在阻抗控制內層（例如帶狀線），但是實際上，工程師必須經常使用外層進行所有或者部分高速節點的佈線。 要使SI最佳並保持電路板去耦，就應該盡可能將接地層/電源層成對布放。 如果只能有一對接地層/電源層，你就只有將就了。 如果根本就沒有電源層，根據定義你可能會遇到SI問題。 你還可能遇到這樣的情况，即在未定義訊號的返回通路之前很難模擬或者模擬電路板的效能。

4、串擾和阻抗控制

來自鄰近訊號線的耦合將導致串擾並改變訊號線的阻抗。 相鄰平行訊號線的耦合分析可能决定訊號線之間或者各類訊號線之間的“安全”或預期間距（或者平行佈線長度）。 比如，欲將時鐘到數據訊號節點的串擾限制在100mV以內，卻要訊號走線保持平行，你就可以通過計算或模擬，找到在任何給定佈線層上訊號之間的最小允許間距。 同時，如果設計中包含阻抗重要的節點（或者是時鐘或者專用高速記憶體架構），你就必須將佈線放置在一層（或若干層）上以得到想要的阻抗。

5、重要的高速節點

延遲和時滯是時鐘佈線必須考慮的關鍵因素。 因為時序要求嚴格，這種節點通常必須採用端接器件才能達到最佳SI質量。 要預先確定這些節點，同時將調節元器件放置和佈線所需要的時間加以計畫，以便調整信號完整性設計的指針。

6、電路板科技選擇

不同的驅動科技適於不同的任務。 訊號是點對點的還是一點對多抽頭的？ 訊號是從電路板輸出還是留在相同的電路板上？ 允許的時滯和雜訊裕量是多少？ 作為信號完整性設計的通用準則，轉換速度越慢，信號完整性越好。 50MHz時鐘採用500ps上升時間是沒有理由的。 一個2-3ns的擺率控制器件速度要足够快，才能保證SI的品質，並有助於解决象輸出同步交換（SSO）和電磁相容（EMC）等問題。

在新型FPGA可程式設計技術或者用戶定義ASIC中，可以找到驅動科技的優越性。 採用這些定制或者半定制器件，你就有很大的餘地選定驅動幅度和速度。 設計初期，要滿足FPGA或ASIC設計時間的要求並確定恰當的輸出選擇，如果可能的話，還要包括引脚選擇。   

在這個設計階段，要從IC供應商那裡獲得合適的模擬模型。 為了有效的覆蓋SI模擬，你將需要一個SI模擬程式和相應的模擬模型（可能是IBIS模型）。

最後，在預佈線和佈線階段你應該建立一系列設計指南，它們包括∶目標層阻抗、佈線間距、傾向採用的器件工藝、重要節點拓撲和端接規劃。

7、電路板預佈線階段

預佈線SI規劃的基本過程是首先定義輸入參數範圍（驅動幅度、阻抗、跟踪速度）和可能的拓撲範圍（最小/最大長度、短線長度等），然後運行每一個可能的模擬組合，分析時序和SI模擬結果，最後找到可以接受的數值範圍。

接著，將工作範圍解釋為PCB佈線的佈線約束條件。 可以採用不同軟體工具執行這種類型的“清掃”準備工作，佈線程式能够自動處理這類佈線約束條件。 對多數用戶而言，時序資訊實際上比SI結果更為重要，互連模擬的結果可以改變佈線，從而調整訊號通路的時序。

在其它應用中，這個過程可以用來確定與系統時序指針不相容的引脚或者器件的佈局。 此時，有可能完全確定需要手工佈線的節點或者不需要端接的節點。 對於可程式設計器件和ASIC來說，此時還可以調整輸出驅動的選擇，以便改進SI設計或避免採用離散端接器件。

電路板設計

8、電路板佈線後SI模擬

一般來說，SI設計指導規則很難保證實際佈線完成之後不出現SI或時序問題。 即使設計是在指南的引導下進行，除非你能够持續自動檢查設計，否則，根本無法保證設計完全遵守準則，因而難免出現問題。 佈線後SI模擬檢查將允許有計劃地打破或者改變設計規則，但是這只是出於成本考慮或者嚴格的佈線要求下所做的必要工作。

現在，採用SI模擬引擎，完全可以模擬高速數位PCB甚至是多板系統，自動遮罩SI問題並生成精確的“引脚到引脚”延遲參數。 只要輸入信號足够好，模擬結果也會一樣好。 這使得器件模型和電路板製造參數的精確性成為决定模擬結果的關鍵因素。 很多設計工程師將模擬“最小”和“最大”的設計角落，再採用相關的資訊來解决問題並調整生產率。

9、電路板製造階段

採取上述措施可以確保電路板的SI設計品質，在電路板裝配完成之後，仍然有必要將電路板放在測試平臺上，利用示波器或者TDR（時域反射計）量測，將真實電路板和模擬預期結果進行比較。 這些量測數據可以幫助你改進模型和製造參數，以便你在下一次預設計調研工作中做出更佳的（更少的約束條件）決策。

10、模型的選擇

關於模型選擇的文章很多，進行靜態時序驗證的工程師們可能已經注意到，儘管從器件資料表可以獲得所有的數據，要建立一個模型仍然很困難。 SI模擬模型正好相反，模型的建立容易，但是模型數據卻很難獲得。 本質上，SI模型數據唯一的可靠來源是IC供應商，他們必須與設計工程師保持默契的配合。 IBIS模型標準提供了一致的數據載體，但是IBIS模型的建立及其品質的保證卻成本高昂，IC供應商對此投資仍然需要市場需求的推動作用，而電路板製造商可能是唯一的需方市場。

11、未來電路板科技的趨勢

設想系統中所有輸出都可以調整以匹配佈線阻抗或者接收電路的負載，這樣的系統測試方便，SI問題可以通過程式設計解决，或者按照IC特定的工藝分佈來調整電路板使SI達到要求，這樣就能使設計容差更大或者使硬體設定的範圍更寬。

現時，業界也在關注一種SI器件科技，其中許多科技包含設計好的端接裝置（比如LVDS）和自動可程式設計輸出强度控制和動態自動端接功能，採用這些科技的電路板設計可以獲得優良的SI品質，但是，大多數科技與標準的CMOS或者TTL邏輯電路差別太大，與現有模擬模型的配合不大好。

囙此，EDA公司也正加入到電路板設計的競技場之中，人們為了在設計初期解决SI問題已經做了大量工作，將來，不必SI專家就能借助自動化工具解决SI問題。 儘管現時科技還沒有發展到那個水准，但是人們正探索新的設計方法，從“SI和時序佈線”出發開始電路板設計的科技仍在發展，預計未來幾年內將誕生新的電路板設計科技。